उच्च ब्रेकडाउन वोल्टेज एमओएस कैपेसिटर अल्ट्रा लघु कम रिसाव 50V तार बंधनशील कैपेसिटर एसएलसी चिप

HACC101S10V500 100pF 50V एमओएस संधारित्र उच्च ब्रेकडाउन वोल्टेज कम रिसाव तार बंधन अल्ट्रा-मिनीचर एसएलसी चिप

डाई-लेवल कैपेसिटर असेंबली की विश्वसनीयताः ब्रेकडाउन वोल्टेज, वायर बॉन्ड अखंडता और लघुकरण की भूमिका

जब चिप कैपेसिटर फील्ड में विफल हो जाता है, तो मूल कारण शायद ही कभी एक साधारण विद्युत अतिसंवेदनशीलता होता है। अधिक बार, विफलता तीन तंत्रों में से एक के लिए वापस जाती हैःअपर्याप्त वोल्टेज मार्जिन से त्वरित डायलेक्ट्रिक टूटना, तार बंधन थर्मल साइकिल के तहत थकान, या अल्ट्रा-मिनी-मृत्यु की स्वचालित विधानसभा के दौरान शारीरिक क्षति।100 पीएफ ± 20%, 50 वी डीसी डबल-साइड बॉन्डर्ड सिंगल लेयर सिरेमिक कैपेसिटर (एसएलसी)यह विशेष रूप से संरक्षक डिजाइन मार्जिन, धातु विज्ञान अनुकूलन, और एक यांत्रिक रूप से मजबूत डबल-मार्जिन वास्तुकला के माध्यम से सभी तीन विफलता मोड को समाप्त करने के लिए इंजीनियर है।

डाईलेक्ट्रिक टूटने का मार्जिनः 2.5* डेरैटिंग क्यों मायने रखता है

HACC101S10V500 के साथ निर्मित हैकक्षा I COG/NPO (C0G/NP0) अतिस्थिर सिरेमिक डायलेक्ट्रिकउच्च विद्युतरोधक शक्ति के लिए अनुकूलित. निरंतर डीसी वोल्टेज रेटिंग 50V है, और प्रत्येक डाई विद्युत स्थिरता सत्यापित करने के लिए काफी उच्च वोल्टेज पर 100% उत्पादन परीक्षण से गुजरता है।यह रूढ़िवादी अवमूल्यन न्यूनतम 2.5* सुरक्षा मार्जिन उच्च विश्वसनीयता अनुप्रयोगों में सिरेमिक कंडेनसरों के लिए उद्योग विश्वसनीयता मानकों द्वारा अनुशंसित 2* रेटिंग दिशानिर्देश से अधिक।

सर्किट डिजाइनर के लिए, यह मार्जिन वास्तविक दुनिया की मजबूती में अनुवाद करता हैः आपूर्ति क्षणिक, लोड असंगत प्रतिबिंब,और डीसी पूर्वाग्रह बदलाव है कि एक 16V या 25V रेटेड संधारित्र चुनौती दे सकते हैं काफी हेडरूम के साथ अवशोषित कर रहे हैं28-50V पर काम करने वाले GaN पावर एम्पलीफायर ड्रेन बायस नेटवर्क में,HACC101S10V500 कई कम वोल्टेज कंडेनसरों के सीरीज स्टैकिंग की आवश्यकता के बिना विश्वसनीय डीसी ब्लॉक और आरएफ बायपास प्रदान करता है , असेंबली जटिलता, और संचयी सहिष्णुता स्टैक अप।

सीओजी/एनपीओ डाईलेक्ट्रिक वोल्टेज स्थिरता में भी योगदान देता है। फेरोइलेक्ट्रिक क्लास II डाईलेक्ट्रिक्स (एक्स7आर, एक्स5आर) के विपरीत जहां बैरियम टाइटेनट डोमेन क्लैंप होने पर सीसी पूर्वाग्रह के तहत क्षमता गिर जाती है,सीओजी/एनपीओ पैराइलेक्ट्रिक है, क्षमता मूल्य 0V से पूर्ण रेटेड वोल्टेज तक स्थिर हैइसका मतलब है कि आप 0V DC पूर्वाग्रह पर डिजाइन बायपास प्रतिबाधा एक ही प्रतिबाधा अपने सर्किट पूर्ण संचालन वोल्टेज पर देखता है।

TaN/TiW/Ni/Au धातुकरण: वायर बॉन्ड इंटरफेस का इंजीनियरिंग

केवल 0.50*0.50 मिमी के चिप पर, तार बंधन पैड क्षेत्र आमतौर पर 200*200μm या उससे छोटा होता है। इस पैमाने पर, बंधन पैड की धातु विज्ञान गुणवत्ता सीधे असेंबली उपज को निर्धारित करती है।HACC101S10V500 में चार परतों वाला पतली फिल्म स्टैक हैTaN/TiW/Ni/Au (≥2.5μm Au न्यूनतम)जो कई उत्पाद पीढ़ियों में सुधारे गए हैं ताकि लगातार, उच्च-शक्ति वाले थर्मोसोनिक सोने के तार बंधन प्रदान किए जा सकें।

यहाँ प्रत्येक परत के लिए इंजीनियरिंग तर्क है, सब्सट्रेट से बंधन तार के लिएः

एक ही TaN/TiW/Ni/Au स्टैक दोनों शीर्ष और नीचे इलेक्ट्रोड के लिए सममित रूप से लागू किया जाता है,जिसका अर्थ है कि नीचे के इलेक्ट्रोड चांदी के इपोक्सी इंटरडिफ्यूजन और मरने संलग्न के दौरान मिलाप leaching के खिलाफ समान सुरक्षा का आनंद लेता है.

दोतरफा सीमांकित वास्तुकलाः एक साथ दोनों इलेक्ट्रोडों की सुरक्षा

HACC101S10V500 की एक विशिष्ट विशेषता इसकीदो तरफ़ा सीमारेखा (मार्जिन) डिजाइनसिंगल-बॉर्डर या बॉर्डरलेस कैपेसिटर के विपरीत, इस चिप में ऊपर और नीचे दोनों सतहों पर एक गैर-धातुकृत, उजागर सिरेमिक सीमा शामिल है।असेंबली इंजीनियरों के लिए व्यावहारिक लाभ दो गुना है:

निचला मार्जिन ️ इपॉक्सी कंटेनमेंटःसंवाहक चांदी इपोक्सी (H20E) मरने संलग्न के दौरान, नीचे सिरेमिक सीमा सोने के इलेक्ट्रोड के चारों ओर एक भौतिक प्रतिधारण अंगूठी बनाता है। जब पिक-एंड-प्लेस कोलेट चिप को नीचे दबाता है,अतिरिक्त एपॉक्सी बाहर की ओर बहता है लेकिन सीमा के बाहर नहीं चढ़ सकता हैनतीजा: निचले इलेक्ट्रोड से चिप की साइडवॉल तक इपॉक्सी ब्रिजिंग के शून्य उदाहरण,शीर्ष सोने के पैड के लिए एक आम दोष मोड सीमा रहित चिप कैपेसिटर में जो गुप्त शॉर्ट-सर्किट विफलताओं का उत्पादन करता है.

अधिकतम मार्जिन ️ बांड क्षेत्र की परिभाषाःऊपरी सिरेमिक सीमा स्वचालित तार बंधन के लिए एक स्पष्ट रूप से दिखाई देने वाला संदर्भ किनारा बनाती है।बंधन कंकड़ या गेंद केशिका को सोने के इलेक्ट्रोड किनारे के अंदर कम से कम 25μm तक उतरना चाहिएइलेक्ट्रोड के किनारे के बहुत करीब रखे गए बंधन सेरामिक माइक्रो-क्रैकिंग का खतरा होता है; मार्जिन इस अस्पष्टता को समाप्त करता है और भागों के बीच मैन्युअल निरीक्षण के बिना उच्च गति से बंधन की अनुमति देता है।

यह सममित संरचना परिचालन लाभ भी प्रदान करती हैः चिप के दोनों चेहरे कार्यात्मक रूप से समान होते हैं, पिक-एंड-प्लेस के दौरान ऊपर/नीचे उन्मुखीकरण की आवश्यकताओं को समाप्त करते हैं।एक उत्पादन लाइन में जो प्रति वर्ष लाखों प्लेसमेंट करती है, प्रति घटक एक एकल दृष्टि निरीक्षण चरण को समाप्त करने से मापने योग्य थ्रूपुट लाभ उत्पन्न होता है।

अल्ट्रा कॉम्पैक्ट 0.50*0.50*0.15 मिमी: छोटा आकार, बड़ा प्रभाव

पर0.50*0.50*0.15 मिमी (20*20*6 मिमी), HACC101S10V500 केवल 0.25 मिमी2 के वाहक क्षेत्र पर कब्जा कर लेता है, जो हाई-के सिरेमिक फॉर्मूलेशन (X7R वेरिएंट के लिए K≈140) द्वारा सक्षम किए गए क्षमता घनत्व को प्राप्त करता है।यह पदचिह्न मानक 30 एमएल एसएलसी की तुलना में 4* क्षेत्र की कमी और 0402 एसएमडी एमएलसीसी की तुलना में 2* कमी का प्रतिनिधित्व करता है।उच्च घनत्व आरएफ मॉड्यूल के लिए जहां हर वर्ग माइक्रोन मायने रखता हैफ़िल्टर बैंक इस घनत्व लाभ सीधे प्रति मॉड्यूल अधिक कार्यक्षमता में अनुवाद करता है.

द0.15 मिमी (6 मिली) अल्ट्रा-लो प्रोफाइलसमान रूप से महत्वपूर्ण है। मानक 0402 MLCCs 0.50 मिमी ऊंचे हैं; HACC101S10V500 उस ऊंचाई का एक तिहाई से कम है। तंग ढक्कन रिक्ति के साथ हेर्मेटिक हाइब्रिड मॉड्यूल में,ऊर्ध्वाधर रूप से ढेर किए गए बहु-चिप संयोजनों में, और पतले रूप कारक उपभोक्ता उपकरणों में, यह Z-ऊंचाई लाभ कंडेनसर को सब्सट्रेट पर सबसे ऊंचा घटक के रूप में समाप्त करता है ¢ अक्सर मोटाई में कमी की एक पूरी पीढ़ी को सक्षम करता है।

उच्च उपज वाली असेंबली के लिए सर्वोत्तम प्रथाएं

• डाई संलग्न करेंःवायवीय माइक्रो-डिस्पेंसर का उपयोग करके प्रवाहकीय चांदी इपोक्सी (Epotek H20E) का एक नियंत्रित माइक्रो-डॉट लागू करें। 10°C/सेक से कम रैंप दर के साथ 120°C पर 30 मिनट के लिए इलाज करें।निचले सिरेमिक सीमा में स्वाभाविक रूप से अधिक एपॉक्सी होता है ∙ ±20% से अधिक परिशुद्धता वॉल्यूमेट्रिक नियंत्रण की आवश्यकता नहीं होती है.
• तार बंधन:25μm (1 मिली) Au तार, थर्मोसोनिक गेंद या 120-150°C चरण तापमान पर कंकड़ बंधन।बंधन लैंडिंग बिंदु सोने के इलेक्ट्रोड के ऊपरी किनारे से ≥25μm होना चाहिए ceramic margin provides the visual reference for this clearanceअनुशंसित बंधन मापदंडः 15-35gf बल, 40-100mW अल्ट्रासोनिक, 10-50ms अवधि।
• निरीक्षण:50* आवर्धन पर पोस्ट-बॉन्ड विजुअल निरीक्षण। >25% पैड विरूपण, दृश्य क्रेटरिंग, या इलेक्ट्रोड मार्जिन के 25μm के भीतर प्लेसमेंट के साथ बॉन्ड को अस्वीकार करें।जांचें कि निचला एपॉक्सी फिलेट सिरेमिक सीमा के भीतर है ️ चिप साइडवॉल पर कोई एपॉक्सी दिखाई नहीं देता है.
• भंडारणः20-25°C, 40-60% आरएच पर नाइट्रोजन से शुद्ध कैबिनेट में वेफल्स पैक या जेल-पैक। 1 वर्ष की गारंटीकृत शेल्फ लाइफ; ≤30°C/85% आरएच (MSL 1) पर असीमित फर्श जीवन।

मुख्य अनुप्रयोग क्षेत्र

• आरएफ पावर एम्पलीफायर मॉड्यूलःडीसी अवरुद्ध और GaN-on-SiC HEMT आउटपुट चरणों में आपूर्ति बायपास जो 28-50V ड्रेन वोल्टेज पर काम करते हैं।5* वोल्टेज मार्जिन और सीओजी/एनपीओ डाईलेक्ट्रिक पूर्ण पूर्वाग्रह के तहत कैपेसिटेंस ड्रॉप के बिना विश्वसनीय बायपास प्रदान करते हैं.
• चरणबद्ध-सरणी एंटीना सिस्टम:100 पीएफ इंटर-स्टेज युग्मन कम ईएसआर के साथ और प्रति सरणी पैनल हजारों बंधन के माध्यम से स्थिर बंधन खींच शक्ति के साथ। दो तरफा सीमा अधिकतम थ्रूपुट पर पूरी तरह से स्वचालित असेंबली को सक्षम करती है।
• ऑप्टिकल ट्रांससीवर डीसी ब्लॉक (100G/400G QSFP-DD):अल्ट्रा-लो 0.15 मिमी प्रोफाइल हेर्मेटिक TOSA/ROSA मॉड्यूल ढक्कन के भीतर फिट बैठता है। कम DF 25-56Gbaud PAM4 डेटा दरों पर न्यूनतम संकेत अखंडता गिरावट सुनिश्चित करता है।
• परिशुद्धता उपकरण फ्रंट-एंडःलगभग शून्य TCC और VCC सॉफ्टवेयर मुआवजा तालिकाओं की आवश्यकता के बिना तापमान पर कैलिब्रेशन सटीकता बनाए रखते हैं।
• ऑटोमोटिव रडार और वी2एक्स संचारः-55°C से +125°C तक पूर्ण पैरामीटर अनुपालन हुड के नीचे और बाहरी-माउंटेड इलेक्ट्रॉनिक्स को कवर करता है जिसमें AEC-Q200 ग्रेड 1 आवश्यकताओं से अधिक पर्याप्त मार्जिन होता है।
• आईओटी और एज कंप्यूटिंग आरएफ मॉड्यूलःकॉम्पैक्ट पदचिह्न और वायर-बॉन्ड एकीकरण अंतरिक्ष-प्रतिबंधित सेंसर नोड्स और एज गेटवे में ट्रांससीवर आईसी के साथ चिप-स्केल सह-पैकेजिंग को सक्षम करते हैं।

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